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Paquet : gplcver (2.12a-1.1 et autres)

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Verilog simulator

Cver is a full 1995 IEEE P1364 standard Verilog simulator. It also implements some of the 2001 P1364 standard features. All three PLI interfaces (tf_, acc_, and vpi_) are implemented as defined in the IEEE 2001 P1364 LRM.

Homepage: http://www.pragmatic-c.com/gpl-cver

Étiquettes: Développement de logiciel: Étiquette supplémentaire nécessaire, Interpréteur, Domaine: Électronique, Mis en œuvre en: implemented-in::c, role::program, But: Simulation

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