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Datei:X86 Paging PAE 4K.svg

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Beschreibung

Beschreibung
Deutsch: Schematische Darstellung der Umsetzung von linearen in physische Adressen bei x86-kompatiblen CPUs im 32-Bit Protected Mode. Seitengröße: 4 KiByte, mit PAE.
English: Schematic drawing of translation of linear to physical addresses in 32 bit protected mode. Page size: 4 KiByte, PAE enabled
Datum
Quelle eigene Arbeit / own work using Xfig.
Urheber RokerHRO
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aktuell15:15, 29. Okt. 2008Vorschaubild der Version vom 15:15, 29. Okt. 2008621 × 396 (33 KB)Marcos vicenteCorrected a small typo.
12:39, 28. Okt. 2008Vorschaubild der Version vom 12:39, 28. Okt. 2008621 × 396 (31 KB)Marcos vicente{{Information |Description= |Source= |Date= |Author= |Permission= |other_versions= }}
12:49, 20. Mär. 2008Vorschaubild der Version vom 12:49, 20. Mär. 2008621 × 396 (20 KB)RokerHRO{{Information |Description={{de|Schematische Darstellung der Umsetzung von linearen in physische Adressen bei x86-kompatiblen CPUs im 32-Bit Protected Mode. Seitengröße: 4 KiByte, mit PAE.}} {{en|Schematic drawing of translation of linear to physical ad

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